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1 原理图
编译成功后其波形图如下：
2、信号发生器
library ieee;
use ieee.std_logic_1164.all;
use ieee.std_logic_unsigned.all;
entity sele is
port(clk: in std_logic;
jian: in std_logic_vector(1 downto 0);
oclk: out std_logic);
end;
architecture s_1 of sele is
signal full : std_logic;
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